6SN1118-0DH23-0AA0
发布时间：2018-12-24 10:57:25点击率：
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6SN1118-0DH23-0AA0 6SN1118-0DH23-0AA0 该系统电源较复杂，有多达8种不同的电源电压值，其中5V和3．3V由CPCI机箱提供。5V供给DC／DC器件降压以产生其他电源电压，同时给1553总线的变压器供电。3．3V是系统主电源，包BPHY、时钟器件、FPGA和CPU以及PCI桥器件(PLX6466)的I／O部分等。其他电源电压都是由5V或3．3V经电源器件降压得到。 表1、2分别为CPU和PCI桥器件的功耗需求，CPU器件对上电顺序没有要求。其中VDD1．5V是PPC440EPx的内核电压，SOVDD是CPU的DDR2接口电源；1．8V为PCI桥的内核电压，VDDIO是PCI桥的接口电源。 6SN1118-0DH23-0AA0 该系统采用DDR2作为内存，使用4片Micron公司的MT47H64M16，容量为512MB。每片DDR2器件的内核、接口和DLL的电源电压都是1．8V，大电流为440mA。另外需特别注意DDR2的VREF以及地址和控制信号的端口接电压VTT，其电压值都是0．9V。其中，VREF对容差的要求非常严格(小于2％)，不过其对电流的要求较小。而对VTT不仅有严格的容差要求，而且还要求其能在瞬间输出或吸收很大的电流。同时，VREF岍要随着VDD的变化而变化，VTT也要跟踪VREF的变化。通常的LDO难以完成这样的工作，必须采用专用的DDR端接电源器件。 该系统使用Spartan3型FPGA器件XC3S200实现1553收发器以及一些接口电路的设计。该器件使用3个电压内核电压INT(1．2V)，辅助电压AUX(2．5V)以及接口电压O(3．3V)。FPGA内部有上电复位电路，只有当这3个电源信号都达到各自门限电压，才释放该复位信号。因此，对这3个电源信号的上电顺序没有要求。不过，如果INT先于AUX上电，则会在上电时额外增加几百毫安的瞬时电流。估计FPGA器件功耗可采用基于电子数据表的工具XPower EsTImator(XPE)或在ISE下直接调用XPower。系统利用XPower软件估计出该设计功耗需求：INT为50mA，AUX为10mA。系统使用两片88E1111作为千兆以太网的PHY器件，该器件以2．5V为砌电压(410mA)，1．0V为内核电压(250mA)。除上述集成电路外，系统还有诸如串行接口B接口、时钟等电路，但功耗都较低。从分析可知：1．5V和1．8V需要使用大功率的电源器件，DDR2的电源需要专用的电源器件，其他电压的功率要求较小。 本公司秉承“顾客至上，锐意进取”的经营理念，
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