BOS 6K-PU-1QA-S76-C

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双击Fast Fourier Transform IP去打开Re-tomize IP，设置Transform Length为512，并选择在Architecture Choice里选择Pipelined, Streaming I/O

3.在Implementation窗口里，将Control Signals设置ARESETN，在Throttle Scheme设置为Non Real Time

4.Add IP，搜索hls，将搜索到的两个IP添加进设计，然后连接HLS和FFT block的端口（连接如下），然后给hls_real2xfft的din_V_V 接口和Hls_xfft2real的dout_V 接口 选择Make External，添加外部接口并分别命名为eal2xfft_din和xfft2real_dout，同理给FFT的aclk和aresetn端口分别Make External，添加 constant IP，联线如下， 点击Regenerate Layout

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点击Validate Design，这时会出现一些 warnings，它们是跟FFT的 s_axis_config pin相关。
注意：这里xff的t配置接口悬空，这是因为由于本设计始终运行在默认模式，现在点击OK 关闭messages，然后点击File > Save Block Design。

6.在Sources窗口右击RealFFT.bd，并选择 generate output products，然后在Sources窗口给RealFFT.bd创建HDL Wrapper。

Step 5: Verify the Design

下面就是用realfft_rtl_tb.v验证设计
1.右击Sources窗口里的Simulation Sources，选择Add Sources，在弹出的窗口里选择Add or Create Simulation Sources，然后Add Files，选ing_IP_with_IPI\lab1\verilog_tb文件夹，并选择Copy sources into the project

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