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发布时间：2019-03-06 11:23:52点击率：
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6ES7153-2BA00-0XB0 FPGA开发—HDL输入 HDL全称是硬件描述语言HardwareDescripTIonLanguage，这种输入方式要追溯的话得到20世纪90年代初了。当时的数字电路的规模已足以让按照当时的输入方式进行门级抽象设计顾左顾不了右了，一不小心很容易出错，而且得进行多层次的原理图切割，为关键的是如何能做到在更抽象的层次上描述数字电路。 于是一些EDA开始提供一种文本形式的，非常严谨，不易出错的HDL输入方式开始提供了。特别是在1980年的时候，美国军方发起来甚高速集成电路（Very-High-SpeedIntegratedCircuit）计划，就是为了在部队中装备中大规模需求的数字电路的设计开发效率，那么这个VHSIC硬件描述语言就是我们现在的VHDL语言，它也是早成为硬件描述语言的标准的。与之相对的是晚些时间民间发起的Verilog，后来到1995年的时候，它的个版本的IEEE标准才出台，但是沿用至今。 前面提到HDL语言具有不同层次上的抽象，这些抽象层有开关级、逻辑门级、RTL级、行为级和系统级，如图3。其中开关级、逻辑门级又叫结构级，直接反映的是结构上的特性，大量的使用原语调用，很类似开始原理图转成门级网表。RTL级又可称为功能级。 6ES7153-2BA00-0XB0 HDL语言除了前面提到的两种外，历史上也出现了其他的HDL语言，有ABEL、AHDL、硬件C语言（SystemC语言、Handle-C）、Systemverilog等。其中ABEL和AHDL算是早期的语言，因为相比前面两种语言来讲，或多或少都有些致命的缺陷而在小范围内使用或者直接淘汰掉了。而因为VHDL和Verilog在仿真方面具有仿真时间长的缺陷，Systemverilog和硬件C语言产生了，从图3看，SystemVerilog是在系统级和行为级上为Verilog做补充，同时硬件C语言产生的原因还有就是有种想把软件和硬件设计整合到一个平台下的思想。 FPGA开发—IP（IntellectualProperty）核 什么是IP核？任何实现一定功能的模块叫做IP（IntellectualProperty）。这里把IP核作为一种输入方式单独列出来，主要考虑到完全用IP核确实是可以形成一个项目。它的产生可以说是这样的一个逆过程。 在随着数字电路的规模不断扩大的时候，面对一个大的工程，工程师们可能是达到一种共识，将这规模巨大而且复杂的设计经常用到的具有一定通用性的功能给独立出来，可以用来其他设计。当下一次设计的时候，发现这些组装好的具有一定功能的模块确实挺好用的，于是越来越多的这种具有一定功能的模块被提取出来，甚至工程师之间用来交换，慢慢大家注意到它的知识产权，于是一种叫做IP知识产权的东西出来了，于是集成电路一个全新领域（IP设计）产生了。 IP按照来源的不同可以分为三类，种是来自前一个设计的内部创建模块，第二种是FPGA厂家，第三种就是来自IP厂商；后面两种是我们关注的，这是我们进行零开发时考虑的现有资源问题，先撇开成本问题，IP方式的开发对项目周期非常有益的，这也是在FPGA应用领域章节陈列相关FPGA厂家IP资源的原因。 6ES7153-2BA00-0XB0 本公司秉承“顾客至上，锐意进取”的经营理念，
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